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ISL5239
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196 CABGA
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VCCIO
VCCIO QOUT9 QOUT6 QOUT4
NC
GND
C
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IIN2
QOUT16 QOUT12 VCCC QOUT7 QOUT1 QOUT3 QOUT0
D
CS
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A5
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IIN6
IIN1
QOUT17 QOUT13 QOUT8 QOUT2
VCCIO QOUT5
FB17
E
P0
VCCC
RD
A4
WR
IIN5
GND
VCCC QOUT14 QOUT10 FB14
FB19
FB18
VCCC
F
VCCIO
P1
P2
P3
P4
FB13
FB16
FB15
GND
FB10
G
P7
P6
P5
GND
P11
SEROUT
FB9
FB12
FB11
SERIN
H
P10
P12
VCCIO
P8
P9
SERSYNC GND
VCCIO SERCLK CLKOUT
J
CLK
GND
RESET
P14
P15
TRIGOUT
FB7
FB6
FB5
FB8
K
P13
TDO
TCK
BUSY
QIN6
QIN0
VCCC
GND
IOUT11
GND
FB0
VCCC
FB3
FB4
L
DCTEST
TDI
TMS
QIN17
QIN9
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VCCIO IOUT13
IOUT9
VCCC
IOUT4
FB1
TRIGIN
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M
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QIN15
QIN13
QIN11
QIN7
QIN4
IOUT16
GND
IOUT7
VCCIO
IOUT3
IOUT0
IOUT2
FBCLK
N
TRST
NC
QIN14
QIN10
VCCC
QIN3
IOUT17 IIOUT12 IOUT10
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GND
VCCIO
NC
IOUT1
P
NC
VCCC
QIN12
QIN8
QIN5
QIN1
IOUT15 IOUT14 VCCIO
GND
IOUT6
IOUT5
VCCC
NC
POWER PIN
SIGNAL PIN
GROUND PIN
Pin Descriptions
THERMAL BALL
NC (Do not connect)
NAME
POWER SUPPLY
VCCC
VCCIO
GND
TYPE
-
-
-
DESCRIPTION
Positive Device Core Power Supply Voltage, 1.8V ± 0.18V.
Positive Device Input/Output Power Supply Voltage, 3.3V ± 0.165V.
Common Ground, 0V
MICROPROCESSOR INTERFACE AND CONTROL
CLK
RESET
P<15:0>
I
I
I/O
4
Input Clock. Rising edge drives all of the devices synchronous operations, except feedback capture.
Reset. (Active Low). Asserting reset will clear all configuration registers to their default values, reset all internal
states, and halt all processing.
16-bit bi-directional data bus that operates with A<5:0>, CS, RD, and WR to write to and read from the devices
internal control registers. When the host system asserts CS and RD simultaneously, P<15:0> is an output bus,
under all other conditions, it is an input bus. Bit 15 is the MSB.
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